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Groups > de.sci.electronics > #369495
| From | Leo Baumann <ib@leobaumann.de> |
|---|---|
| Newsgroups | de.sci.electronics |
| Subject | Re: Echter Zufall mit iTSC-counter |
| Date | 2026-09-19 16:03 +0200 |
| Message-ID | <118m4n2$fi0i$1@solani.org> (permalink) |
| References | <118kj9q$gqv2$1@solani.org> <118ks8h$elv8$1@solani.org> <118lt61$fcbq$1@solani.org> |
Am 19.09.2026 um 13:54 schrieb Helmut Schellong:
> Leo Baumann wrote on 19.09.2026 04:32:
>> Am 19.09.2026 um 01:59 schrieb Helmut Schellong:
>>> Mittels einer Assembler-Funktion rdtsc(), die ich schon lange
>>> besitze, habe
>>> ich nun einen Generator für echte Zufallszahlen entwickelt.
>>>
>>> http://www.schellong.de/htm/randtsc.c.html
>>>
>>> Ausgabe:
>>> ===========================================================================
>>> 00000276457408345376
>>> 00000276457428358754
>>> 00000276457431266902
>>> 00000276457435366459
>>> 00000276457448473547
>>> 00000276457451206089
>>> 00000276457454226781
>>> 00000276457457223742
>>> 00000276457460060553
>>> 00000276457474314196
>>> 00000276457477764702
>>> 00000276457485946076
>>> 00000276457489986581
>>> 00000276457500216563
>>> 00000276457560363833
>>> 00000276457566068760
>>> 00000276457571709045
>>> 00000276457594841516
>>> 00000276457618375542
>>> 00000276457628372033
>>> 00000276457634496509
>>> 00000276457641473652
>>> 00000276457662760413
>>> 00000276457667772505
>>> ===========================================================================
>>>
>>> In Prozessoren amd64 befindet sich ein 64-bit-Counter, der von einer
>>> Taktfrequenz
>>> im Giga-Hertz-Bereich angetrieben wird.
>>> Der verändert sich durch die Zeitdauer von nur einem Funktionsaufruf
>>> bereits
>>> um Millionen in seinem Zählerstand.
>>>
>>> Mindestens die 4/5 Ziffern von rechts können als random verwendet
>>> werden.
>>> Oft sind bereits 1- bis 2-stellige Zahlen in geringerer Anzahl nützlich.
>>>
>>> Das Kommando nimmt ein Argument entgegen: Die Anzahl von
>>> ausgegebenen Zahlen.
>>> Voreingestellt ist die Anzahl 8.
>>
>> Kompliziert!
>> Warum benutzt Du keinen Maschinenbefehl?
>>
>> retry_loop:
>> RDRAND rax
>> JNC retry_loop
>>
>> RDRAND grift auf den internen, hardwarebasierten
>> Zufallszahlengenerator zurück, der echtes thermisches Rauschen als
>> Quelle benutzt.
>
> Neuere Prozessoren haben diese Instruktion, und auch eine für AES.
> Das kenne ich seit langer Zeit.
> Ich habe aber erst seit 2023 einen geeigneten Prozessor.
>
> Und ich werde mein Kommando randtsc noch erweitern, zu einem Test- und
> Experimentier-Tool.
> Ich bin gerade dabei - wird heute fertig.
nasmsection .text
global get_rdrand_64
;
---------------------------------------------------------------------------
; get_rdrand_64
; Gibt eine 64-Bit-Hardware-Zufallszahl zurück.
; C-Prototyp: uint64_t get_rdrand_64(int *success);
;
; Input: RDI = Zeiger auf eine Status-Variable (success)
; Output: RAX = Die generierte Zufallszahl (0 bei Fehler)
;
---------------------------------------------------------------------------
get_rdrand_64:
mov ecx, 10 ; Maximale Anzahl der Versuche (Retry-Counter)
.loop_rdrand:
rdrand rax ; Versuche, 64-Bit-Zufall in RAX zu laden
jc .success ; Wenn Carry-Flag (CF) = 1, war es
erfolgreich -> Springe zu .success
pause ; Dem Prozessor eine kurze Pause gönnen
(Strom sparen / Thread freigeben)
loop .loop_rdrand ; ECX dekrementieren, wenn > 0, Schleife
wiederholen
.fail:
mov qword [rdi], 0 ; Setze *success = 0 (Fehlgeschlagen)
xor rax, rax ; RAX auf 0 setzen
ret
.success:
mov qword [rdi], 1 ; Setze *success = 1 (Erfolgreich)
; Die Zufallszahl befindet sich bereits in RAX und wird zurückgegeben
ret
--
Public Webspace von Ingenieurbüro Baumann:
https://hidrive.ionos.com/share/sc0px3oy7x
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Re: Echter Zufall mit iTSC-counter Thomas Prufer <prufer.public@mnet-online.de.invalid> - 2026-09-26 09:24 +0200
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Re: Echter Zufall mit iTSC-counter Leo Baumann <ib@leobaumann.de> - 2026-09-19 22:02 +0200
Re: Echter Zufall mit RDRAND Leo Baumann <ib@leobaumann.de> - 2026-09-20 03:29 +0200
Re: Echter Zufall mit RDRAND Helmut Schellong <var@schellong.biz> - 2026-09-20 11:52 +0200
Re: Echter Zufall mit RDRAND Leo Baumann <ib@leobaumann.de> - 2026-09-20 17:59 +0200
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Re: Echter Zufall mit iTSC-counter Marte Schwarz <marte.schwarz@gmx.de> - 2026-09-20 22:38 +0200
Re: Echter Zufall mit iTSC-counter Helmut Schellong <var@schellong.biz> - 2026-09-20 23:03 +0200
Re: Echter Zufall mit iTSC-counter Helmut Schellong <var@schellong.biz> - 2026-09-21 21:10 +0200
Re: Echter Zufall mit iTSC-counter Stefan Wiens <s.wi@gmx.net> - 2026-09-21 21:18 +0200
Re: Echter Zufall mit iTSC-counter Alexander Schreiber <als@usenet.thangorodrim.de> - 2026-09-21 12:02 +0200
Re: Echter Zufall mit iTSC-counter Helmut Schellong <var@schellong.biz> - 2026-09-21 12:57 +0200
Re: Echter Zufall mit iTSC-counter Marc Haber <mh+usenetspam2616@zugschl.us> - 2026-09-19 08:59 +0200
Re: Echter Zufall mit iTSC-counter Alexander Schreiber <als@usenet.thangorodrim.de> - 2026-09-19 09:53 +0200
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Re: Echter Zufall mit iTSC-counter Helmut Schellong <var@schellong.biz> - 2026-09-19 14:36 +0200
Re: Echter Zufall mit iTSC-counter Thomas Prufer <prufer.public@mnet-online.de.invalid> - 2026-09-20 09:37 +0200
Re: Echter Zufall mit iTSC-counter Peter Thoms <dl6lat@darc.de> - 2026-09-19 12:13 +0200
Re: Echter Zufall mit iTSC-counter Helmut Schellong <var@schellong.biz> - 2026-09-19 14:11 +0200
Re: Echter Zufall mit iTSC-counter Ralph Aichinger <ra@h5.or.at> - 2026-09-19 08:26 +0000
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Re: Echter Zufall mit iTSC-counter Helmut Schellong <var@schellong.biz> - 2026-09-19 14:33 +0200
Re: Echter Zufall mit iTSC-counter Andreas Fecht <forum@aftec.de> - 2026-09-19 20:42 +0200
Re: Echter Zufall mit iTSC-counter Arno Welzel <usenet@arnowelzel.de> - 2026-09-26 13:12 +0200
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Re: Echter Zufall mit iTSC-counter Leo Baumann <ib@leobaumann.de> - 2026-10-03 23:08 +0200
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Re: Echter Zufall mit iTSC-counter Helmut Schellong <var@schellong.biz> - 2026-10-04 12:02 +0200
Re: Echter Zufall mit iTSC-counter Helmut Schellong <var@schellong.biz> - 2026-10-04 12:07 +0200
Re: Echter Zufall mit iTSC-counter Alexander Schreiber <als@usenet.thangorodrim.de> - 2026-10-04 15:01 +0200
Re: Echter Zufall mit iTSC-counter Helmut Schellong <var@schellong.biz> - 2026-10-04 17:49 +0200
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