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Re: 74HC595 und 74HC166 an einem SPI

Path csiph.com!fu-berlin.de!uni-berlin.de!individual.net!not-for-mail
From Hans-Peter Diettrich <DrDiettrich1@aol.com>
Newsgroups de.sci.electronics
Subject Re: 74HC595 und 74HC166 an einem SPI
Date Fri, 14 Apr 2017 11:53:36 +0200
Lines 19
Message-ID <elblceFh3m5U3@mid.individual.net> (permalink)
References <ocosqr$q65$1@news.albasani.net> <ocpo7l$hcl$1@dont-email.me> <ocq0o7$2du$1@news.albasani.net>
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Content-Type text/plain; charset=utf-8; format=flowed
Content-Transfer-Encoding 8bit
X-Trace individual.net cr2bba46JtK0qX/hN1Afwg7ZznCbMfX8YLx2GLBo5NnMVbOT/q
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User-Agent Mozilla/5.0 (Windows NT 5.1; rv:45.0) Gecko/20100101 Thunderbird/45.8.0
In-Reply-To <ocq0o7$2du$1@news.albasani.net>
Xref csiph.com de.sci.electronics:226254

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Am 14.04.2017 um 10:20 schrieb Johannes Bauer:

> Mein Denkfehler war, dass ich dachte, vor der fallenden Flanke wird
> der Input gesampelt. Dabei ändert da nur der Master die Daten. Schade
> eigentlich, dass man nicht beides konfigurieren kann.

Wozu? Wenn die Weitergabe mit der gleichen Flanke nicht funktioniert, 
dann kannst Du auch keine 166 hintereinanderschalten!

Da jammern die Leute immer, daß die IC zu langsam sind, bis man 
plötzlich feststellt, daß gerade eine synchrone (getaktete) Schaltung 
ohne Signalverzögerung garnicht gehen würde! Schlimm nur, wenn die 
Delays sich aufsummieren, dann begrenzen sie die Taktrate.


Eben fällt mir noch auf, daß normalerweise alle digitalen Eingänge mit 
dem Prozessortakt synchronisiert werden. Ist das bei SPI nicht so? Bei I2C?

DoDi

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74HC595 und 74HC166 an einem SPI Johannes Bauer <dfnsonfsduifb@gmx.de> - 2017-04-14 00:07 +0200
  Re: 74HC595 und 74HC166 an einem SPI Hans-Peter Diettrich <DrDiettrich1@aol.com> - 2017-04-14 02:21 +0200
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    Re: 74HC595 und 74HC166 an einem SPI Hans-Peter Diettrich <DrDiettrich1@aol.com> - 2017-04-14 11:40 +0200

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